mirror of
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synced 2025-01-19 17:46:23 +07:00
ARM: S5PC100: Cleanup the GPIOlib code
This patch clean up the GPIO code and removes useless GPIO addresses. It can be calculated with offset, the 'base' member of s3c_gpio_chip is also initialized in the init function. Signed-off-by: Kukjin Kim <kgene.kim@samsung.com>
This commit is contained in:
Kukjin Kim
parent
4d9374f39e
commit
2ad530d2e7
@ -1,5 +1,7 @@
|
||||
/*
|
||||
* arch/arm/plat-s5pc100/gpiolib.c
|
||||
/* linux/arch/arm/mach-s5pc100/gpiolib.c
|
||||
*
|
||||
* Copyright (c) 2010 Samsung Electronics Co., Ltd.
|
||||
* http://www.samsung.com
|
||||
*
|
||||
* Copyright 2009 Samsung Electronics Co
|
||||
* Kyungmin Park <kyungmin.park@samsung.com>
|
||||
@ -80,129 +82,214 @@ static struct s3c_gpio_cfg gpio_cfg_noint = {
|
||||
.get_pull = s3c_gpio_getpull_updown,
|
||||
};
|
||||
|
||||
/*
|
||||
* GPIO bank's base address given the index of the bank in the
|
||||
* list of all gpio banks.
|
||||
*/
|
||||
#define S5PC100_BANK_BASE(bank_nr) (S5P_VA_GPIO + ((bank_nr) * 0x20))
|
||||
|
||||
/*
|
||||
* Following are the gpio banks in S5PC100.
|
||||
*
|
||||
* The 'config' member when left to NULL, is initialized to the default
|
||||
* structure gpio_cfg in the init function below.
|
||||
*
|
||||
* The 'base' member is also initialized in the init function below.
|
||||
* Note: The initialization of 'base' member of s3c_gpio_chip structure
|
||||
* uses the above macro and depends on the banks being listed in order here.
|
||||
*/
|
||||
static struct s3c_gpio_chip s5pc100_gpio_chips[] = {
|
||||
{
|
||||
.base = S5PC100_GPA0_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPA0(0),
|
||||
.ngpio = S5PC100_GPIO_A0_NR,
|
||||
.label = "GPA0",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPA1_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPA1(0),
|
||||
.ngpio = S5PC100_GPIO_A1_NR,
|
||||
.label = "GPA1",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPB_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPB(0),
|
||||
.ngpio = S5PC100_GPIO_B_NR,
|
||||
.label = "GPB",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPC_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPC(0),
|
||||
.ngpio = S5PC100_GPIO_C_NR,
|
||||
.label = "GPC",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPD_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPD(0),
|
||||
.ngpio = S5PC100_GPIO_D_NR,
|
||||
.label = "GPD",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPE0_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPE0(0),
|
||||
.ngpio = S5PC100_GPIO_E0_NR,
|
||||
.label = "GPE0",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPE1_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPE1(0),
|
||||
.ngpio = S5PC100_GPIO_E1_NR,
|
||||
.label = "GPE1",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPF0_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPF0(0),
|
||||
.ngpio = S5PC100_GPIO_F0_NR,
|
||||
.label = "GPF0",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPF1_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPF1(0),
|
||||
.ngpio = S5PC100_GPIO_F1_NR,
|
||||
.label = "GPF1",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPF2_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPF2(0),
|
||||
.ngpio = S5PC100_GPIO_F2_NR,
|
||||
.label = "GPF2",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPF3_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPF3(0),
|
||||
.ngpio = S5PC100_GPIO_F3_NR,
|
||||
.label = "GPF3",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPG0_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPG0(0),
|
||||
.ngpio = S5PC100_GPIO_G0_NR,
|
||||
.label = "GPG0",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPG1_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPG1(0),
|
||||
.ngpio = S5PC100_GPIO_G1_NR,
|
||||
.label = "GPG1",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPG2_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPG2(0),
|
||||
.ngpio = S5PC100_GPIO_G2_NR,
|
||||
.label = "GPG2",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPG3_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPG3(0),
|
||||
.ngpio = S5PC100_GPIO_G3_NR,
|
||||
.label = "GPG3",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPH0_BASE,
|
||||
.chip = {
|
||||
.base = S5PC100_GPI(0),
|
||||
.ngpio = S5PC100_GPIO_I_NR,
|
||||
.label = "GPI",
|
||||
},
|
||||
}, {
|
||||
.chip = {
|
||||
.base = S5PC100_GPJ0(0),
|
||||
.ngpio = S5PC100_GPIO_J0_NR,
|
||||
.label = "GPJ0",
|
||||
},
|
||||
}, {
|
||||
.chip = {
|
||||
.base = S5PC100_GPJ1(0),
|
||||
.ngpio = S5PC100_GPIO_J1_NR,
|
||||
.label = "GPJ1",
|
||||
},
|
||||
}, {
|
||||
.chip = {
|
||||
.base = S5PC100_GPJ2(0),
|
||||
.ngpio = S5PC100_GPIO_J2_NR,
|
||||
.label = "GPJ2",
|
||||
},
|
||||
}, {
|
||||
.chip = {
|
||||
.base = S5PC100_GPJ3(0),
|
||||
.ngpio = S5PC100_GPIO_J3_NR,
|
||||
.label = "GPJ3",
|
||||
},
|
||||
}, {
|
||||
.chip = {
|
||||
.base = S5PC100_GPJ4(0),
|
||||
.ngpio = S5PC100_GPIO_J4_NR,
|
||||
.label = "GPJ4",
|
||||
},
|
||||
}, {
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPK0(0),
|
||||
.ngpio = S5PC100_GPIO_K0_NR,
|
||||
.label = "GPK0",
|
||||
},
|
||||
}, {
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPK1(0),
|
||||
.ngpio = S5PC100_GPIO_K1_NR,
|
||||
.label = "GPK1",
|
||||
},
|
||||
}, {
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPK2(0),
|
||||
.ngpio = S5PC100_GPIO_K2_NR,
|
||||
.label = "GPK2",
|
||||
},
|
||||
}, {
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPK3(0),
|
||||
.ngpio = S5PC100_GPIO_K3_NR,
|
||||
.label = "GPK3",
|
||||
},
|
||||
}, {
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPL0(0),
|
||||
.ngpio = S5PC100_GPIO_L0_NR,
|
||||
.label = "GPL0",
|
||||
},
|
||||
}, {
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPL1(0),
|
||||
.ngpio = S5PC100_GPIO_L1_NR,
|
||||
.label = "GPL1",
|
||||
},
|
||||
}, {
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPL2(0),
|
||||
.ngpio = S5PC100_GPIO_L2_NR,
|
||||
.label = "GPL2",
|
||||
},
|
||||
}, {
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPL3(0),
|
||||
.ngpio = S5PC100_GPIO_L3_NR,
|
||||
.label = "GPL3",
|
||||
},
|
||||
}, {
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPL4(0),
|
||||
.ngpio = S5PC100_GPIO_L4_NR,
|
||||
.label = "GPL4",
|
||||
},
|
||||
}, {
|
||||
.base = (S5P_VA_GPIO + 0xC00),
|
||||
.config = &gpio_cfg_eint,
|
||||
.irq_base = IRQ_EINT(0),
|
||||
.chip = {
|
||||
@ -212,7 +299,7 @@ static struct s3c_gpio_chip s5pc100_gpio_chips[] = {
|
||||
.to_irq = samsung_gpiolib_to_irq,
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPH1_BASE,
|
||||
.base = (S5P_VA_GPIO + 0xC20),
|
||||
.config = &gpio_cfg_eint,
|
||||
.irq_base = IRQ_EINT(8),
|
||||
.chip = {
|
||||
@ -222,7 +309,7 @@ static struct s3c_gpio_chip s5pc100_gpio_chips[] = {
|
||||
.to_irq = samsung_gpiolib_to_irq,
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPH2_BASE,
|
||||
.base = (S5P_VA_GPIO + 0xC40),
|
||||
.config = &gpio_cfg_eint,
|
||||
.irq_base = IRQ_EINT(16),
|
||||
.chip = {
|
||||
@ -232,7 +319,7 @@ static struct s3c_gpio_chip s5pc100_gpio_chips[] = {
|
||||
.to_irq = samsung_gpiolib_to_irq,
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPH3_BASE,
|
||||
.base = (S5P_VA_GPIO + 0xC60),
|
||||
.config = &gpio_cfg_eint,
|
||||
.irq_base = IRQ_EINT(24),
|
||||
.chip = {
|
||||
@ -241,147 +328,26 @@ static struct s3c_gpio_chip s5pc100_gpio_chips[] = {
|
||||
.label = "GPH3",
|
||||
.to_irq = samsung_gpiolib_to_irq,
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPI_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPI(0),
|
||||
.ngpio = S5PC100_GPIO_I_NR,
|
||||
.label = "GPI",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPJ0_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPJ0(0),
|
||||
.ngpio = S5PC100_GPIO_J0_NR,
|
||||
.label = "GPJ0",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPJ1_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPJ1(0),
|
||||
.ngpio = S5PC100_GPIO_J1_NR,
|
||||
.label = "GPJ1",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPJ2_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPJ2(0),
|
||||
.ngpio = S5PC100_GPIO_J2_NR,
|
||||
.label = "GPJ2",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPJ3_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPJ3(0),
|
||||
.ngpio = S5PC100_GPIO_J3_NR,
|
||||
.label = "GPJ3",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPJ4_BASE,
|
||||
.config = &gpio_cfg,
|
||||
.chip = {
|
||||
.base = S5PC100_GPJ4(0),
|
||||
.ngpio = S5PC100_GPIO_J4_NR,
|
||||
.label = "GPJ4",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPK0_BASE,
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPK0(0),
|
||||
.ngpio = S5PC100_GPIO_K0_NR,
|
||||
.label = "GPK0",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPK1_BASE,
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPK1(0),
|
||||
.ngpio = S5PC100_GPIO_K1_NR,
|
||||
.label = "GPK1",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPK2_BASE,
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPK2(0),
|
||||
.ngpio = S5PC100_GPIO_K2_NR,
|
||||
.label = "GPK2",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPK3_BASE,
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPK3(0),
|
||||
.ngpio = S5PC100_GPIO_K3_NR,
|
||||
.label = "GPK3",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPL0_BASE,
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPL0(0),
|
||||
.ngpio = S5PC100_GPIO_L0_NR,
|
||||
.label = "GPL0",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPL1_BASE,
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPL1(0),
|
||||
.ngpio = S5PC100_GPIO_L1_NR,
|
||||
.label = "GPL1",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPL2_BASE,
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPL2(0),
|
||||
.ngpio = S5PC100_GPIO_L2_NR,
|
||||
.label = "GPL2",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPL3_BASE,
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPL3(0),
|
||||
.ngpio = S5PC100_GPIO_L3_NR,
|
||||
.label = "GPL3",
|
||||
},
|
||||
}, {
|
||||
.base = S5PC100_GPL4_BASE,
|
||||
.config = &gpio_cfg_noint,
|
||||
.chip = {
|
||||
.base = S5PC100_GPL4(0),
|
||||
.ngpio = S5PC100_GPIO_L4_NR,
|
||||
.label = "GPL4",
|
||||
},
|
||||
},
|
||||
};
|
||||
|
||||
static __init int s5pc100_gpiolib_init(void)
|
||||
{
|
||||
struct s3c_gpio_chip *chip;
|
||||
int nr_chips;
|
||||
struct s3c_gpio_chip *chip = s5pc100_gpio_chips;
|
||||
int nr_chips = ARRAY_SIZE(s5pc100_gpio_chips);
|
||||
int gpioint_group = 0;
|
||||
int i;
|
||||
|
||||
chip = s5pc100_gpio_chips;
|
||||
nr_chips = ARRAY_SIZE(s5pc100_gpio_chips);
|
||||
|
||||
for (; nr_chips > 0; nr_chips--, chip++) {
|
||||
if (chip->config == &gpio_cfg) {
|
||||
/* gpio interrupts */
|
||||
for (i = 0; i < nr_chips; i++, chip++) {
|
||||
if (chip->config == NULL) {
|
||||
chip->config = &gpio_cfg;
|
||||
chip->group = gpioint_group++;
|
||||
}
|
||||
if (chip->base == NULL)
|
||||
chip->base = S5PC100_BANK_BASE(i);
|
||||
}
|
||||
|
||||
samsung_gpiolib_add_4bit_chips(s5pc100_gpio_chips,
|
||||
ARRAY_SIZE(s5pc100_gpio_chips));
|
||||
samsung_gpiolib_add_4bit_chips(s5pc100_gpio_chips, nr_chips);
|
||||
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return 0;
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}
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@ -11,43 +11,6 @@
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#include <mach/map.h>
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/* S5PC100 */
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#define S5PC100_GPIO_BASE S5P_VA_GPIO
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#define S5PC100_GPA0_BASE (S5PC100_GPIO_BASE + 0x0000)
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#define S5PC100_GPA1_BASE (S5PC100_GPIO_BASE + 0x0020)
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#define S5PC100_GPB_BASE (S5PC100_GPIO_BASE + 0x0040)
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#define S5PC100_GPC_BASE (S5PC100_GPIO_BASE + 0x0060)
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#define S5PC100_GPD_BASE (S5PC100_GPIO_BASE + 0x0080)
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#define S5PC100_GPE0_BASE (S5PC100_GPIO_BASE + 0x00A0)
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#define S5PC100_GPE1_BASE (S5PC100_GPIO_BASE + 0x00C0)
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#define S5PC100_GPF0_BASE (S5PC100_GPIO_BASE + 0x00E0)
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#define S5PC100_GPF1_BASE (S5PC100_GPIO_BASE + 0x0100)
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#define S5PC100_GPF2_BASE (S5PC100_GPIO_BASE + 0x0120)
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#define S5PC100_GPF3_BASE (S5PC100_GPIO_BASE + 0x0140)
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#define S5PC100_GPG0_BASE (S5PC100_GPIO_BASE + 0x0160)
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#define S5PC100_GPG1_BASE (S5PC100_GPIO_BASE + 0x0180)
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#define S5PC100_GPG2_BASE (S5PC100_GPIO_BASE + 0x01A0)
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#define S5PC100_GPG3_BASE (S5PC100_GPIO_BASE + 0x01C0)
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#define S5PC100_GPH0_BASE (S5PC100_GPIO_BASE + 0x0C00)
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#define S5PC100_GPH1_BASE (S5PC100_GPIO_BASE + 0x0C20)
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#define S5PC100_GPH2_BASE (S5PC100_GPIO_BASE + 0x0C40)
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#define S5PC100_GPH3_BASE (S5PC100_GPIO_BASE + 0x0C60)
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#define S5PC100_GPI_BASE (S5PC100_GPIO_BASE + 0x01E0)
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#define S5PC100_GPJ0_BASE (S5PC100_GPIO_BASE + 0x0200)
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#define S5PC100_GPJ1_BASE (S5PC100_GPIO_BASE + 0x0220)
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#define S5PC100_GPJ2_BASE (S5PC100_GPIO_BASE + 0x0240)
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#define S5PC100_GPJ3_BASE (S5PC100_GPIO_BASE + 0x0260)
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#define S5PC100_GPJ4_BASE (S5PC100_GPIO_BASE + 0x0280)
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#define S5PC100_GPK0_BASE (S5PC100_GPIO_BASE + 0x02A0)
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#define S5PC100_GPK1_BASE (S5PC100_GPIO_BASE + 0x02C0)
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#define S5PC100_GPK2_BASE (S5PC100_GPIO_BASE + 0x02E0)
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#define S5PC100_GPK3_BASE (S5PC100_GPIO_BASE + 0x0300)
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#define S5PC100_GPL0_BASE (S5PC100_GPIO_BASE + 0x0320)
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#define S5PC100_GPL1_BASE (S5PC100_GPIO_BASE + 0x0340)
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#define S5PC100_GPL2_BASE (S5PC100_GPIO_BASE + 0x0360)
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#define S5PC100_GPL3_BASE (S5PC100_GPIO_BASE + 0x0380)
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#define S5PC100_GPL4_BASE (S5PC100_GPIO_BASE + 0x03A0)
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#define S5PC100EINT30CON (S5P_VA_GPIO + 0xE00)
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#define S5P_EINT_CON(x) (S5PC100EINT30CON + ((x) * 0x4))
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